30计数器怎么写

1.单片机中计数器怎么做

外加显示的,延时查表自己写

ORG 0000H

MAIN:MOV 30H,#00;(给 30H_40H付值)

MOV 31H,#00

MOV 32H,#00

MOV 33H,#00

MOV 34H,#00

MOV 35H,#00

MOV 36H,#00

MOV 37H,#00

L3: CALL L1 ;(调用子程序)

CALL DELAY2 ;(延时)

INC 30H ;(将30中值递增1)

MOV A,30H ;( 将30H)

CJNE A,#0AH,L3

MOV 30H,#0

INC 31H

ACALL L1

MOV A,31H

CJNE A,#06H,L3

MOV 31H,#0

INC 32H

ACALL L1

MOV A,32H

CJNE A,#0AH,L3

MOV 32H,#0

INC 33H

ACALL L1

MOV A,33H

CJNE A,#06H,L3

MOV 33H,#0

INC 34H

ACALL L1

MOV A,34H

CJNE A,#0H,L3

MOV 34H,#0

INC 35H

ACALL L1

MOV A,35H

CJNE A,#02H,L3

L4: ACALL L1

CALL DELAY2

INC 34H

ACALL L1

CALL DELAY2

MOV A,34H

CJNE A,#04H,L4

MOV P1,#0

JMP MAIN

L1: MOV DPTR,#TABLE

MOV A,30H

MOVC A,@A+DPTR

MOV P1,A

CLR P0.0

CALL DELAY

SETB P0.0

MOV A,31H

MOVC A,@A+DPTR

MOV P1,A

CLR P0.1

CALL DELAY

SETB P0.1

MOV A,32H

MOVC A,@A+DPTR

MOV P1,A

CLR P0.2

CALL DELAY

SETB P0.2

MOV A,33H

MOVC A,@A+DPTR

MOV P1,A

CLR P0.3

CALL DELAY

SETB P0.3

MOV A,34H

MOVC A,@A+DPTR

MOV P1,A

CLR P0.4

CALL DELAY

SETB P0.4

MOV A,35H

MOVC A,@A+DPTR

MOV P1,A

CLR P0.5

CALL DELAY

SETB P0.5

MOV A,36H

MOVC A,@A+DPTR

MOV P1,A

CLR P0.6

CALL DELAY

SETB P0.6

MOV A,37H

MOVC A,@A+DPTR

MOV P1,A

CLR P0.7

CALL DELAY

SETB P0.7

RET

END

2.30秒倒计时器课程设计

最低0.27元/天开通百度文库会员,可在文库查看完整内容>

原发布者:梦比优斯1991

30秒倒计时计数器设计——数字电子计数基础课程设计学院:计算机学院专业班级:通信工程10-2班时间:2013年1月7日目录设计要求………………………………………………………………………………………3正文一、倒计时器组成及原理………………………………………………………………31.1倒计时计数器组成……………………………………………………………31.2工作原理………………………………………………………………………3二、拟定设计方案………………………………………………………………………42.1用Multisim进行仿真设计……………………………………………………42.2设计实现数码管显示…………………………………………………………42.3设计555定时振荡实现秒振荡发生功能……………………………………42.4设计实现减法计数功能………………………………………………………52.5设计实现二位数减法计数功能………………………………………………52.6设计实现反馈电路实现30秒计数功能………………………………………52.7设计实现控制电路实现启动、清零/复位和暂停/继续计数控制电路………52.7.1清零/复位电路………………………………………………………………52.7.2暂停/继续计数电路…………………………………………………………6

3.用Verilog设计一个同步30进制可逆计数器

module count(

input clk,

input rst_n,

input clr,

input [9:0]data_set,

input set_en,

output reg[9:0] cnt_out

);

reg [5:0]cnt;

always@(posedge clk or negedge rst_n)begin

if(!rst_n)

cnt_out

4.用Verilog HDL写的 六进制和十进制计数器 以及30万分频器的程序,大

六进制计数器:cout在什么情况下也不等于1,因为 if(q==4'b0101)时cout=0,而下一个状态q==4'b0000,也不会出现q==4'b0111,q==4'b1101,q==4'b1111这几种情况,如果作为进位,建议在(q==4'b0101)时cout=1,其他情况cout=0;

十进制计数器同上

3万分频器,这种结果占空比为1/30000,如果想要占空比为50%,可以计数到14999(3A97),然后清0,把newclk取反,这样高低电平各15000;

initial

begin

newclk

30计数器怎么写

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